Título :	Implementación del algoritmo SAD para el empate de imágenes estéreo en FPGA
Autor(es):	Gerardo Ornelas Vargas
Palabras clave:	Algoritmo SAD Estéreo FPGA Imágenes
Área:	INGENIERÍA Y TECNOLOGÍA
Fecha de publicación :	jun-2008
Facultad:	Facultad de Ingeniería
Programa académico:	Maestría en Ciencias (Instrumentación y Control)
Resumen:	El presente trabajo es la primer parte de la implementación de un sistema genérico de visión estereoscópica en FPGA. Abarca desde la interfaz con los sensores de imagen CMOS, hasta la implementación de un algoritmo de búsqueda por área para la generación de mapas de disparidades. Las etapas de calibración y rectificación fueron realizadas con herramientas de Matlab. El aporte del trabajo es un enfoque novedoso en la implementación del algoritmo de búsqueda por área logrando incrementar la capacidad de procesamiento de 1.03 fps hasta 12.79 fps con la posibilidad de duplicarlo agregando una serie de registros. Respecto a otros trabajos se mejora el desempeño del algoritmo quedando a un nivel competitivo con algoritmos de búsqueda por características. Como parte de los resultados, se muestran los recursos utilizados en el FPGA por cada una de las etapas implementadas y los resultados de cada etapa del procesamiento con las imágenes de prueba sawtooth, venus, cones y Tsukuba. "This work is the generic stereo vision system FPGA implementation first part. It embraces from CMOS image sensor interface, to disparity map generator by an area based search algorithm implementation. Calibration and rectification steps where carried out with Matlab tools. This work contribution is a novel approach in area based algorithm implementation. This approach boost its processing capabilities from 1.03 fps to 12.79 fps, with possibilities of double this performance by mean of a series of registers. Making a comparision between this work and others, it turns out the improvement in performance, having processing capabilities that can compete with characteristics based search algorithms. As part of results, FPGA usage resources are shown for each implemented step. Also every processing step with test images sawtooth, venus, cones and Tsukuba."
URI:	http://ri-ng.uaq.mx/handle/123456789/935
Aparece en:	Maestría en Ciencias (Instrumentación y Control)

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